DE2_实验练习解答—lab_3：锁存器、触发器和寄存器(digital_Logic)(DE2)(quartus_II)AET-电子技术应用-最丰富的电子设计资源平台

DE2_实验练习解答—lab_3：锁存器、触发器和寄存器(digital_Logic)(DE2)(quartus_II)
所属分类：解决方案
上传者：hbcxzcj
文档大小：545 K
标签：Altera Verilog Quartus II
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文档介绍：Altera的FPGA含有可供用户使用的触发器电路。在Part IV演示如何使用它。这里探讨如何不使用专用触发器来创建存储单元。图1描述了门控锁存器电路。可用门级电路或表达式来描述。
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