基于FPGA的高速并行Viterbi译码器的设计与实现
kaiyun官方注册2007年第1期
童 琦，何洪路，吴明森
摘要：针对319卷积编码，提出一种Viterbi译码器的FPGA实现方案。该方案兼顾了资源消耗和译码效率，通过有效的时钟和存储介质复用，实现了高速并行的译码功能，并利用Verilog语言在Xilinx ISE 6．2中进行了建模仿真和综合实现。
Abstract：
Key words :
摘 要：针对319卷积编码，提出一种Viterbi译码" title="Viterbi译码">Viterbi译码器的FPGA实现方案。该方案兼顾了资源消耗和译码效率，通过有效的时钟和存储介质复用，实现了高速并行的译码功能，并利用Verilog语言在XilinxISE" title="ISE">ISE6．2中进行了建模仿真和综合实现。
关键词：Viterbi译码路径值" title="路径值">路径值回溯" title="回溯">回溯
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