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一种应用于低电压GPS接收机的高线性度低噪声放大器
2020年电子技术应用第3期
陈 利,刘艳艳
天津市光电子薄膜器件与技术重点实验室,天津300350
摘要:基于0.18 μm RFCMOS工艺,设计了一种应用于低电压GPS接收机的高线性度低噪声放大器。采用体偏压控制的跨导导数叠加技术,有效改善了低噪声放大器的线性度,显著提高了辅助管的调节精度。通过在输入端主放大管的栅源两端并联电容的方法,降低二次谐波对三阶交调失真的影响,进一步改善了线性度。同时,折叠式共源共栅的拓扑结构,降低了电路的工作电压。仿真结果表明,在0.9 V供电下,工作频率为1.575 GHz时,该低噪声放大器的输入三阶交调点为6.63 dBm,噪声系数为1.53 dB,增益为13.16 dB,输入回波损耗和输出回波损耗分别为-32.43 dB和-24.58 dB,功耗为8.78 mW。
中图分类号:TN409
文献标识码:A
DOI:10.16157/j.issn.0258-7998.191323
中文引用格式:陈利,刘艳艳. 一种应用于低电压GPS接收机的高线性度低噪声放大器[J].电子技术应用,2020,46(3):10-13.
英文引用格式:Chen Li,Liu Yanyan. A high linearity LNA for low voltage GPS receiver[J]. Application of Electronic Technique,2020,46(3):10-13.
A high linearity LNA for low voltage GPS receiver
Chen Li,Liu Yanyan
Key Laboratory for Photoelectronic Thin Film Devices and Technology of Tianjing,Tianjin 300350,China
Abstract:Based on 0.18 μm RFCMOS technology, a high linearity low noise amplifier(LNA) for low voltage GPS receivers was designed. By using the trans-conductance derivative superposition technique with bulk bias control, the adjustment accuracy of auxiliary transistor was remarkably improved. An extra capacitance is added between gate and source nodes of input transistor in a parallel manner to reduce the effect of second-order harmonic on IMD3. In addition, folded cascade structure is adopted to make the circuit work under low voltage conditions. The simulation results shown that the LNA achieves a 6.63 dBm IIP3, a noise figure of 1.53 dB, a 13.16 dB power gain, the input and output return losses are -32.43 dB and -24.58 dB at 1.575 GHz with the core LNA consuming 8.78 mW at 0.9 V power supply.
Key words :high linearity;LNA;trans-conductance derivative superposition technique

0 引言

近些年来,随着无线通信系统技术的发展,越来越多的便携式电子产品向着低功耗、高集成度的方向发展。GPS服务因其能够实时追踪和导航的优点,现已成为无线通信设备不可或缺的功能[1-3]。而低噪声放大器(LNA)作为GPS接收机前端的第一级有源器件,其性能显著影响着整个接收机的性能。因此对LNA噪声、功耗、线性度等性能指标提出了越来越严苛的要求。

GPS接收机接收到的信号非常微弱,尽管1 dB压缩点能够较为轻易地满足,但同样也要避免某些特定环境下由于干扰信号引入造成的非线性失真。例如军用或某些特定商业用途中,当人为干扰信号存在时,对GPS接收机的线性度要求会大大提高。本文在跨导导数叠加技术[4]的基础上,采用体偏压控制的跨导导数叠加技术[5],数倍提高了补偿三次非线性系数辅助管的调节精度。通过在输入端主放大管的栅源两端并联电容的方法[6],降低二次谐波对三阶交调失真的影响,进一步改善了线性度。同时,采用折叠式共源共栅的拓扑结构[7],降低了电路的工作电压。

1 消除三次非线性

MOS管的三阶非线性是LNA三阶交调失真的主要来源。工作在饱和区的共源级MOS管,其漏极电流id关于栅源电压vgs的泰勒级数展开式为:

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而跨导的非线性导致了共源级放大器的非线性。由共源级LNA的输入三阶交调点(IIP3)表达式[8]

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可知,为了提高IIP3,应尽量减小三次非线性系数gm3的值,即减小跨导gm的二阶偏导gm″的值。为此,有学者提出跨导导数叠加技术,其结构如图1所示,由主放大管Ma和辅助放大管Mb并联组成。主放大管的栅极电压Vbias1和辅助放大管的栅极电压Vbias1-Vshift分别确保主放大管Ma和辅助放大管Mb工作在强反型区和弱反型区。通过调整M1和M2的宽长比和偏置条件,使得主放大管Ma与辅助放大管Mb两者跨导的二阶偏导gm″正负峰值对齐,如图2所示。从而令两者三次非线性系数之和接近于零,进而改善共源级LNA的线性度。

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在此基础上,本文采用体偏压控制的跨导导数叠加技术如图3所示,主放大管M1和辅助放大管M2使用相同的栅压Vbias,根据阈值电压Vth的计算公式:

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其中,Vth0是VBS为0时的阈值电压,γ为体效应系数,φS为表面势参数,VBS为衬源电势差,L1与L2组成滑动变阻器。通过调节VBS的大小令辅助管M2工作在弱反型区。当辅助放大管M2分别由栅压Vbias1-Vshift和体偏压Vbs控制时,扫描各自的偏置电压Vbias1和Vbias。Vshift取值范围在0.08 V~0.23 V时,与Vbs取值范围在-0.30 V~-1.08 V时,两者都会得到由M2a到M2b一簇近似相同的曲线,如图4所示。即两种技术能够产生相同的补偿三次非线性系数的效果。尽管两种不同技术使得辅助管M2表现出相似的gm″曲线,但采用体偏压控制的跨导导数叠加技术的控制电压Vbs的范围,是传统跨导导数叠加技术控制电压Vshift的5.2倍,因此能够在工艺、电压、温度变化的影响下,更为精准地调节gm″的曲线。

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2 削弱二次非线性的影响

当在共源级LNA输入端输入频率相近的双音信号时,在输出节点产生的二次谐波,通过寄生的栅源电容和栅漏电容反馈路径,与输入信号再次由于跨导的二次非线性产生三次非线性项,进而恶化线性度。本文采用折叠式共源共栅的结构,大大削弱了通过栅漏电容反馈路径的影响,同时通过在主放大管栅源两端并联电容的方法,削弱了由于跨导二次非线性对LNA线性度的影响。

当考虑到二次非线性对线性度的影响时,共源级LNA的IIP3可以表示为[6]

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其中,gm是MOS管的跨导,ω为工作频率,Ls为源极简并电感,Cgs0为MOS管的栅源电容,Cadd为MOS管栅源两端并联的电容,Lg为栅极电感。通过导数叠加技术,gm″的影响可以近似忽略。在MOS管栅源两端并联电容Cadd,式(5)中IIP3的分母gm′项中由于Cadd的引入,降低了二次非线性对三阶交调失真的影响,从而进一步改善线性度。

3 电路设计

本文提出的应用于低电压GPS接收机的高线性度低噪声放大器结构如图5所示。主放大管M1与共栅管PM1组成折叠式共源共栅结构,降低了工作电压。输入端的主放大管M1管与Ls构成源简并电感结构,能够在窄带实现良好的输入匹配,同时获得较低的噪声系数。主放大管M1管与辅助放大管M2管利用体偏压控制的跨导导数叠加技术,能够极大地削弱三次非线性项gm2的影响,进而大幅改善低噪声放大器的线性度。Cadd用于削弱二次非线性对LNA线性度的影响。M3、R1、R2与PM2、R4分别为M1、M2与PM1提供偏置电压,L2与C2实现输出匹配。

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4 仿真结果与分析

基于TSMC 0.18 μm RFCOMS工艺,利用Cadence Spectre RF进行调试并仿真。在0.9 V工作电压下,最终测试的S参数如图6所示。S11与S22分别为-32.43 dB和-24.58 dB,LNA能够与前后级实现良好的匹配。S21为13.16 dB,能为GPS接收机在第一级提供足够的增益。测试的噪声系数如图7所示,LNA在工作频率1.575 GHz时的噪声系数为1.53 dB。最终测试的IIP3如图8所示,LNA的IIP3为6.63 dBm,在低电压下表现出较好的线性度。且LNA的功耗为8.78 mW,符合低功耗的设计要求。将本文设计的LNA与已发表的相关论文作对比,如表1所示。结果表明,本文设计的LNA在低电压条件下,噪声性能及线性度具有一定优势。

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5 结论

本文采用体偏压控制的跨导导数叠加技术在有效提高低噪声放大器线性度的基础上,数倍提高了gm″的调节精度。通过增加补偿电容的方法,降低二次谐波对三阶交调失真的影响,进一步改善了线性度。同时采用折叠式共源共栅的拓扑结构,有效降低了工作电压。仿真结果表明,在0.9 V供电电压下,工作频率为1.575 GHz时,功耗为8.78 mW,IIP3为6.63 dBm,噪声系数为1.53 dB,同时该电路能够提供13.16 dB的增益,并能实现良好的输入输出匹配。

参考文献

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作者信息:

陈 利,刘艳艳

(天津市光电子薄膜器件与技术重点实验室,天津300350)

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