回顾Virtual JTAG在一个项目中的成功应用
这些天在回顾两年前做的一个产品。得益于当时每天都写下的几行工作记录，这个产品的开发过程我还能回忆起来。在这个产品开发的各个阶段，VirtualJTAG和Tcl都发挥了重要作用。投入几天的时间开发一个小工具，在完成后就能持续
发表于 2010/5/4 14:06:39
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Quartus II中添加Tk程序的几个关键语句
发表于 2010/4/29 15:08:15
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Virtual JTAG仿真要点
半年前应jack0321朋友的要求，riple就想着要写这个题目，四个月前终于有机会做了仿真，还写了个自动生成测试向量的脚本，后来忙着其他事情，就拖到了现在。VJI的部分功能是通过自定义逻辑来实现的。对VJI仿真的目的就是验证这部分逻辑以及这部分逻辑与用户设计之
发表于 2010/4/28 15:13:44
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从PFL megafunction中学到的Virtual JTAG使用技巧
现在开发的产品需要借用CPLD烧写NorFlash，可选的方案有两个：采用Altera的ParallelFlashLoader，或者自己用VJTAG做一个。采用PFL虽然速度够快，但是曾经有过文件不匹配的失败经历，所以采用了后一个方案。CPLD代码和Tcl底层操作很快开发出来了，做软件的同事开发的Tcl
发表于 2010/4/28 11:10:51
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Virtual JTAG仿真要点（附图）
VirtualJTAG仿真要点图形说明。从下图可以看出VirtualJTAG与RealJTAG的对应关系。下面两幅Modelsim仿真截屏的上半部分是VJI命令发出后RealJTAG的状态变化，下半部分是VirtualJTAG状态机的变化。一、device_virtual_ir_shiftVirtualIR操作对应一次RealIR操作和两次RealDR
发表于 2010/4/28 11:09:40
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Virtual JTAG相关链接
使用VJ的人越来越多了，多好!http://www.antfarm.org/blog/aaronf/2007/08/xii_gathering_the_xbox_dvd_rem.htmlhttp://www.alteraforum.com/forum/showthread.php?t=1686http://www.alteraforum.com/forum/showthread.php?p=6835http://forum.niosforum.com/forum/inde
发表于 2010/4/28 10:36:15
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Virtual JTAG的Xilinx等价工具——BSCAN
偶然在Xilinx的网站上发现了等价的工具BSCAN：UsingtheJTAGInterfaceasaGeneral-PurposeCommunicationPorthttp://toolbox.xilinx.com/docsan/xilinx8/help/iseguide/html/ise_debugging_strategies.htmhttp://toolbox.xilinx.com/docsan/data/alliance/lib/lib3_11.htmh
发表于 2010/4/28 10:34:14
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非常有用的Virtual JTAG——比串口还好用
今天加了一会儿班，把节前调通的网络接口芯片操作程序整理了一下。这个Tcl程序用于控制一个VirtualJTAG接口，通过VirtualJTAG给FPGA输入控制信号，通过FPGA内部的逻辑产生网络接口芯片的控制波形，实现对网络接口芯片的读写操作。通过一段时间的调试，当前这个Tcl程序已
发表于 2010/4/26 10:52:36
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第一个有那么点用处的virtualjtag代码
今天终于把我学到的那么一点点virtualjtag的用法用到了工作中。上午，我用virtualjtag做了一个察看计数器的工具，把我们系统中对nandflash擦除操作的计数值传回来显示。以前，这样的工作要么求助于软件人员，要么就得上signaltap。一直以来，都很羡慕软件人员可以在串口
发表于 2010/4/23 16:49:32
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虚拟JTAG工具在FPGA调试中的应用(续一)
三、Tcl命令的使用。::quartus::jtagTcl命令包中的各条命令都有英文注释，这里就不挨个翻译了。下面，把用户指南里给出的第一个例子逐句分析一下，后面还会给出一个模板。示例如下。其中只给::quartus::jtagTcl命令包中的命令加上了绿色，其余简单的Tcl命令可以按照E文
发表于 2010/4/23 16:47:23
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虚拟JTAG工具在FPGA调试中的应用(续二）
四、verilog代码分析先把关键的verilog代码写在下面。完整的代码在最后，按照我的理解和习惯，对原示例代码的写法作了修改。wire[3:0]counter1;reg[3:0]feed_reg;//四位的DR寄存器，用于加载输入值wiretdi,tck,cdr,cir,e1dr,e2dr,pdr,sdr,udr,uir;regtdo,bypass_reg;wir
发表于 2010/4/23 16:41:33
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虚拟JTAG工具在FPGA调试中的应用(待续)
最近学习了Altera的VirtualJTAG工具的使用。下面是我的使用心得。Altera在QuartusII6.0中加入了一个sld_virtual_jtag参数化宏单元模块，并提供了相应的Tcl程序包。有了这套工具，使用sld_virtual_jtag和相应的Tcl命令，我们就可以构建自己的虚拟JTAG链路，并进行
发表于 2010/4/23 16:37:47
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