PCIe扫盲——PCI-X总线基本概念
PCI-X总线在PCI总线的基础上发展而来，其在软件和硬件层面上都是兼容PCI总线的，但是却显著的提高了总线的性能。也就是说PCI-X的设备可以直接插到PCI的插槽中去，PCI的设备也可以直接插到PCI-X的插槽中去。
发表于 2018/3/28 15:11:43
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PCIe扫盲——66MHz的PCI总线与其技术瓶颈
为了能够取得更高的带宽，新版本的PCI Spec将PCI总线提高到了64-bit并将频率提高到了66MHz，最高支持533MB/s。下图描述的是一个典型的66Mhz，64-bit的PCI系统结构图。
发表于 2018/3/28 14:20:01
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PCIe扫盲——PCI总线配置周期产生和配置寄存器
上一篇文章中也是说到了，I/O Address Space的空间很有限（64KB），所以一般在I/O Space中都有两个寄存器，第一个指向要操作的内部地址，第二个存放读或者写的数据。因此，对于PCI的配置周期来说，包含了两个步骤：
发表于 2018/3/28 13:51:43
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PCIe扫盲——PCI总线的地址空间分配
PCI总线具有32位数据/地址复用总线，所以其存储地址空间为2的32次方=4GB。也就是PCI上的所有设备共同映射到这4GB上，每个PCI设备占用唯一的一段PCI地址，以便于PCI总线统一寻址。每个PCI设备通过PCI寄存器中的基地址寄存器...
发表于 2018/3/28 11:23:14
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FPGA定点小数计算（一）
所谓定点小数，就是小数点固定地隐含在某一位置上的数据。的位置是固定的。我们是要用整数来表示定点小数，由于小数点的位置是固定的，所以就没有必要储存它（如果储存了小数点的位置，那就是浮点数了）。既然没有储存小数点的位置，那么计算机当然就不知道小...
发表于 2018/3/24 20:05:36
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FPGA定点小数计算（零）
首先，说明一下，这一系列的博文是对之前一段时间写的几篇文章的一个整理，在原有文章的基础上添加一些基本的理论。优化文章结构等。
发表于 2018/3/24 18:18:24
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PCIe扫盲——PCI总线的中断和错误处理
PCI总线使用INTA#、INTB#、INTC#和INTD#信号向处理器发出中断请求。这些中断请求信号为低电平有效，并与处理器的中断控制器连接。在PCI体系结构中，这些中断信号属于边带信号(Sideband Signals)，PCI总线规范...
发表于 2018/3/14 10:15:40
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PCIe扫盲——PCI总线的三种传输模式
本文来简单地介绍一下PCI Spec规定的三种数据传输模型：Programmed I/O（PIO），Peer-to-Peer和DMA。
发表于 2018/3/14 9:48:30
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PCIe扫盲——PCI总线中的Reflected-Wave Signaling
PCI Spec规定了每个PCI总线上最多可以连接多达32个PCI设备，但是实际上却远远达不到32个，33MHz的32位PCI总线一般只能连接10到12个负载。
发表于 2018/3/13 20:23:45
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PCIe扫盲——一个典型的PCI总线周期
PCI总线是一种地址和数据复用的总线，即地址和数据占用同一组信号线AD。PCI总线的所有信号都与时钟信号同步，及所有的信号的变化都发生在时钟的上升沿，或者在时钟上升沿进行采样。
发表于 2018/3/13 19:46:35
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PCIe扫盲——PCI总线基本概念
PCI是Peripheral Component Interconnect(外设部件互连标准)的缩写，它曾经是个人电脑中使用最为广泛的接口，几乎所有的主板产品上都带有这种插槽。目前该总线已经逐渐被PCI Express总线所取代。
发表于 2018/3/13 16:02:08
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PCIe扫盲——PCIe简介
PCI-Express是继ISA和PCI总线之后的第三代I/O总线，即3GIO。 由Intel在2001年的IDF上提出，由PCI-SIG（PCI特殊兴趣组织）认证发布后才改名为“PCI-Express”。它的主要优势就是数据传输速率高，另...
发表于 2018/3/12 10:59:58
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一种借助EBR实现数据延时的方法
数据延时线（Delay Line）在数字信号处理中具 有广泛的应用，例如FIR滤波器设计中就会需要用到数据延时线。实际上，在绝大部分的Pipeline设计中都会需要用到数据延时。本文介绍一种基于EBR（Embedded Block RAM，Xilinx叫做BRAM，Altera叫做Embedded memory）的数据延时的实现方法。
发表于 2018/3/11 20:33:24
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再来挖个坑
为了强迫自己整理学习笔记，所以还是和之前一样，先来立一个Flag。预计一个月之后开始连载，主要内容包括PCI、PCI Express、FPGA SerDes、JESD204B的基本概念与原理，以及Lattice的相关IP的说明和使用心得。C...
发表于 2018/3/5 10:31:08
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信号完整性分析——数字电路中时钟抖动（Jitter）
随着通信系统中的时钟速率迈入GHz级，抖动这个在模拟设计中十分关键的因素，也开始在数字设计领域中日益得到人们的重视。在高速系统中，时钟或振荡器波形的时序误差会限制一个数字I/O接口的最大速率。不仅如此，它还会导致通信链路的误码率增大，甚至限...
发表于 2018/2/27 15:15:41
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