【原创】基于FPGA的异步FIFO验证
发表于 2016/1/16 20:27:25
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【原创】基于FPGA的异步FIFO设计
发表于 2016/1/16 18:35:07
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【原创】二进制码转格雷码互转换的FPGA设计
发表于 2016/1/14 22:15:25
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【原创】vivado默认参数设置（二）
发表于 2015/12/2 0:51:47
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发表于 2015/11/29 14:59:56
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【原创】基于两种模式下的同步FIFO设计
所谓FIFO就是先进先出的意思，通俗的说，就像数据从一个管道的一端进去而从管道的另一端输出。FIFO是一个没有地址端口的存储器，它依靠内部写指针（指定写数据的位置）和读指针（指定读数据的位置）来进行数据的存储或读取。FIFO有同步FIFO和异步FIFO之分。它们的区别是
发表于 2015/11/14 16:49:15
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【原创】AXI4 LITE接口模板
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发表于 2015/11/10 21:50:52
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【原创】VGA显示640*480真彩色图像时FPGA存储资源不够用怎么办？
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发表于 2015/10/27 7:46:20
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【原创】在verilog中调用VHDL模块
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