Bingo版HDL-VIP时序约定
曾经Bingo写过CMOS的视频采集模块，即CMOS_RGB565_Capture模块（当然RAW、YCbCr模式的采集，接口不变），已经得到了以下的一组信号：序号信号说明1clk(clk_pixel)视频流像素时钟（当前为24MHz）2cmos_frame_vsync采集后的帧有效信号3cmos_frame_href采集后的行有效信号4
发表于 2014/3/31 10:30:57
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解决WIN7下VS2010由于权限-文件夹无法操作问题
操作系统：Win764Bit8G内存很郁闷，我为啥我一直都是在不停地给自己制造麻烦，然后解决麻烦……问题是这样子的，我打算在软件点击Save，然后再桌面新建一个文件夹，保存当前的图像……。、。。话说这个操作真的很简单。。又不弄数据库，不就是新建文件夹，保存一个文件
发表于 2014/3/27 11:21:18
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VS从6.0升级到高版本的界面问题
由于原工程从6.0升级的，接着在VS2012下开发了一段时间，最后由于XP问题，又回到了VS2010，但是界面问题一直都没能解决。（1）请教过一些大神，未能解决；（2）在2010/12新建工程，依然未能解决(Dialog没新建)（3）查看了相关的设置，没能找到缘由，崩溃了愧的很。。。
发表于 2014/3/27 11:05:00
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VS低版本打开高版本相关技巧/设置（不适用于6.0）
曾经在本科的时候学过MFC，后来一直没用，给忘差不多了。同时由于VerilogHDL的根深蒂固，让我写C，写完if，下一句直接变成了begin，。。。。并行的思维已经占据了我的海马体，写串行很吃力。。。不过最近由于一个东西得改，各种求人有劲使不出来，最后各种请教，还是自
发表于 2014/3/27 10:54:42
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Xilinx/Avnet Spartan-6 LX16开发平台研究之路之屡败屡战-崩溃
Xilinx/AvnetSpartan-6LX16开发平台研究之路之屡败屡战——ByCrazyBingo——201402281、知己知彼，开启Xilinx之路得道Chinaaet，去年写了几篇酸不垃圾的博文，受coco姐馈赠，AvnetLX16平台，板载XilinxSpartan-6FPGA，型号为XC6SLX16，硬件MCB，PCI等，1.5W逻辑单元，用
发表于 2014/3/24 16:54:21
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苦逼Writer and 68013 Reset必须上拉+滤波电容
先说点别的：不知道最近是不是触犯神灵了，自从我卸载了WindowsLive2009，准备尝试升级WindowsLive2012，但纠结于2012发博客时，无法给我显示标签页，一气之下卸载了2012，重新装WindowsLive。。。。结果神奇的事情发生了，它提示我已经安装了W
发表于 2014/3/17 19:05:41
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【超详细教程】使用Windows Live Writer 2012和Office Word 2013 发布文章到博客园全面总结
【超详细教程】使用WindowsLiveWriter2012和OfficeWord2013发布文章到博客园全面总结转载：http://www.cnblogs.com/liuxianan/archive/2013/04/13/3018732.html去年就知道有这个功能，不过没去深究总结过，最近有写网络博客的欲望了，于是又重新拾起这玩意儿。具体到底
发表于 2014/2/21 13:51:46
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Altium PCB二维码Logo设计
AltiumPCB二维码Logo设计每次设计PCB的时候，都会在空白部分放Logo上去，一来板卡显得更充实，二来更有成就感一些。。。今天突然想着。。。这两年二维码越来越火，火到快爆发，不如在板卡上放一个二维码上去。。。。。不过先得解决一个问题，AltiumDesigner2013的Exampl
发表于 2014/2/20 16:25:49
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BGA 256 FPGA 逆袭4层PCB设计
BGA256FPGAPCB设计终于耐不住寂寞，开始了PCB设计。。为了降低成本，拟采用4层板搞定256IO的FPGA，同时使用所有的IO，绝不浪费任何一丝的资源。。。。大多数业内人士说，256IO4层全部走线，可能性不大。。。不好意思，我好想实现了。。。且不说我Layout的怎么样，先说说
发表于 2014/2/20 15:58:03
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Altera BGA 封装及走线摘要
AlteraBGA封装及走线摘要再也忍受不了TQFP的引脚数量了，不断的鄙视自己，在逆袭中成长，终于开始了BGA之路（且说FPGA，虽然曾经设计过0.65mm的CMOSSensorDemo）。研究了一下AlteraBGA封装，常用的就以下三种，都是1mm间隔的。。。如下图所示：1mm倒装焊BGANSMD焊盘过孔
发表于 2014/2/20 15:33:00
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JLINK Debugger aborted问题解决
最近联调ARM+FPGA，不经意间遇到好多JLINK的问题。。在保证所有的Wire都正常连接的情况下，最突出的问题如下，郁闷的要死：Error:TargetDLLhasbeencancelled.Debuggeraborted!不知道咋地，突然就出现这个问题。Jlink无法下载ARM了，检查了一边，线啥的都是插好了。。。
发表于 2014/2/13 21:33:49
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【技术分享】16：VIP_Board V2，迷你版视频图像处理板卡出炉
首先，晒晒去年，额不对，是前年给大家设计的VIP_Board了。。。首先，CycloneII已经过时了，其实当年的板卡对用户没有开放较多的IO，开发不方便，再者只能VGA显示。。。。总之。。。，太不方便了。。。简直就是垃圾中的极品为了解决当年的弊端，最近心血来潮，设计地第
发表于 2014/1/8 23:18:04
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【技术分享】15：FPGA+USB+CMOS板子归来，竟然意外沉金
2014年1曰6日：转眼间1年过去了，时间过得so快！！！继@木头同学的后尘（1曰4日到）（http://blog.chinaaet.com/detail/34589.html），我的板子也到了，哈了个哈不知道是新年礼物，还是长得帅有特权，板子到了，莫名其妙给我做了沉金，360°无死角，怎么看怎么帅，到底要
发表于 2014/1/6 10:16:11
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ARM-FPGA杜邦线之片间传输--高速数据串扰
有人问起我这问题。。。。我又找不到当年的博客了。。。。只能再发一次。。。。。。。。。。。。。。。。。。。ARM和FPGA之间用批量数据传输，慎用杜邦线啊！！！片间传输--高速数据串扰这几天调试一个东东，STM32的FSMC传输数据给Bingo自制的VGA控制
发表于 2014/1/5 9:39:19
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【最苦逼电工】FPGA+ARM=1080P LCD记录一次开发历程-YouKU视频
大家写NB或者苦逼，都是总结过去的为吧，呵呵我完整地实时记录一下我这次FPGA+ARM=LCD显示控制器的开发的开发历程。当然最初的梦想应该追溯到2012年8月份了，当年采用CycloneIVFPGA，以及STM32实现了，发挥了CycloneIV强大的可编程锁相环，实现了动态时钟分配，完成了“
发表于 2014/1/3 10:52:40
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