【最牛B电工】新书封面新鲜出炉
发表于 12/27/2013 1:42:25 PM
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新书《深入理解Altera FPGA 应用设计》出版倒计时
内容简介本书结合作者多年工作实践，以开发流程为主线，通过大量实例详细介绍了FPGA开发、调试方面的一些基本方法和独特技巧；提出了一种“自动化”开发设计的理念，即通过批处理加脚本的方式自动完成FPGA设计工程的建立、编译和转移，以
发表于 12/24/2013 2:53:07 PM
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【技术分享】FPGA复位电路的实现及其时序分析
FPGA复位电路的实现及其时序分析概述大部分的FPGA和ASIC设计都是基于大量flip-flop或者寄存器的同步系统设计，所以所有这些同步单元的起始状态或者将要返回的状态是一个已知状态（罗辑‘1’或者‘0’）就显得非常重要
发表于 12/24/2013 9:51:11 AM
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【技术分享】FPGA高级设计实例-时序优化之设计结构扁平化
翻译《AdvancedFPGADesignArchitecture,Implementation,andOptimization》一书部分章节，不是因为舍不得花钱买已出版的翻译版本，只是真心觉得翻译的很坑爹，所以把一些有用的章节按照自己的理解编译出来，一方面可以作为内部参考，另一个方面可以加深自己对原版的理解
发表于 12/16/2013 3:40:03 PM
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【技术分享】翻译：FPGA高级设计第一章之时序优化
1.3时序优化时序一般是指一个设计的时钟速度，一个设计中的任何两个时序单元之间最大延时将决定这个设计的最大时钟速度。理想的时钟速度是存在于底层的抽象，而不是本书别处讨论的速度面积平衡中的速度。因为时钟速度
发表于 12/16/2013 12:59:07 PM
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[原创博文] 有计划写一本关于ALTERA FPGA开发设计提高方面的书
计划写一本关于Altera器件开发设计方面的书，整理了一个目录，希望大家多给一些建议和意见！！！ALTERAFPGA设计提高第一章好好准备你的FPGA设计1.1FPGA设计要求“软硬兼施”吗1.2如何帮助项目选择一个合适的FPGA1.3教你如何从顶层规划你的设计1.4进行早期功
发表于 5/28/2013 3:53:08 PM
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【再说FPGA】ECO那些事之属性编辑器
ECO那些事之属性编辑器王敏志概述进行ECOs有两种方法，一种是直接在ChipPlanner里进行，另外一种是在属性编辑器里进行ECOs。本文试图结合笔者在TDC设计中使用的功能尽量详细地描述一下属性编辑器，毕竟属性编辑器可以
发表于 3/22/2013 3:55:56 PM
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【再说FPGA】设计和仿真6.25G速率下的ALTERA器件StratixII GX
设计和仿真6.25G速率下的ALTERA器件StratixIIGX王敏志概述点对点的高速设计可以利用ALTERA的GXB之Basic模式来实现，ALTERA给出了这种模式下6.25G速率下参考实例。本文基于StratixIIGX器件介绍GXB设计和仿真，特别需要
发表于 3/15/2013 11:25:07 AM
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【再说FPGA】PLL那些事之core输出抖动
PLL那些事之core输出抖动王敏志概述这里的PLL是指ALTERA的FPGA内部的PLL，PLL的输出有两种，一种是coreoutput，另外一种是externaloutput，由于ALTERA只给出了PLL的输出到外部引脚的jitter，并没有给出PLL的core
发表于 3/9/2013 1:01:41 PM
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【再说FPGA】TimeQuest之Multicycle Paths
TimeQuest之multicyclepaths王敏志概述Multicyclepaths即多周期路径，指的是两个寄存器之间数据要经过多个时钟才能稳定的路径，一般出现于组合逻辑较大的那些路径。在实际工程中，除了乘除法器等少数比较特殊的电路，一般应该尽量
发表于 3/4/2013 11:33:42 AM
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【技术分享】PET系统之幅度测量
PET系统之幅度测量王敏志概述在《PET之电子学基础》一文中介绍了PET系统主要要进行两项测量，即时间测量和幅度测量。本文试图介绍下所谓的PET系统的幅度测量。PMT信号
发表于 2/26/2013 2:32:34 PM
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【再说FPGA】基于FPGA的TDC那些事之时间信息
基于FPGA的TDC那些事之时间信息王敏志概述设计TDC的目的就是要获得HIT或者说是脉冲的时间信息，在PET系统中需要对“事件”进行符合处理，也即电子准直，其基础就是要知道每个事件的精确时间信息。本文试图阐述TDC在PET
发表于 2/19/2013 10:44:22 AM
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【再说FPGA】基于FPGA的TDC那些事之设计资源LAB
基于FPGA的TDC那些事之设计资源LAB王敏志概述详细了解ALTERAFPGA的LAB结构，在着重详细了解StratixII之后高端器件LAB的基础上比较ALTERA各个系列器件LAB的异同。展示了可以利用ALTERALAB哪些特性来进行TDC设计。LAB&nb
发表于 2/6/2013 1:06:40 PM
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【电子人生】TI产生负电压的电源模块使用问题
TI产生负电压的电源模块使用问题王敏志概述2013年开年项目新一批板子制作完成并焊接好就要开始调试了，再测试各种电压的时候发现一路-3.3V电压不准，输出的只有-2.78V左右。纠结了很长一段时间，排除虚焊、调压电阻等
发表于 2/4/2013 1:38:37 PM
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【再说FPGA】FPGA设计之自动化
FPGA设计之自动化王敏志概述所谓自动化设计，就是在逻辑设计流程中，有些过程需要反复进行，比如编译、仿真和工程调试等等,可以通过一定的方式使得这些流程可以自动运行，而不必每次都需要人工手动去启动。参考[3]介绍
发表于 2/4/2013 10:25:52 AM
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